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文 | 半导体产业纵横
当 2nm 制程的战饱读刚刚擂响，半导体行业的眼神毅然投向了更前沿的技巧无东说念主区—— 1nm（A10）节点。这不仅是摩尔定律的终极科场，更是芯片制造工艺从 " 纳米时期 " 迈向 " 埃米时期 " 的分水岭。
据 IMEC（比利时微电子议论中心）发布的过去硅基晶体管的亚 1nm 工艺节点道路图预测，到 2036 年，半导体器件将从纳米时期迈入原子（埃米）时期，这意味着硅材料的原子级精确制造将成为半导体科技发展的策略冲突标的。1nm 等于 10 埃米，这意味着东说念主类将在原子圭臬上搭建晶体管，每一个原子的位置都关乎成败。
台积电、三星、英特尔三大产业巨头都线路了 1nm 级制程相关筹划，将这场先进工艺的武备竞赛推向埃米时期。在这个节点上，晶体管架构将从 GAA 纳米片进化到 CFET（互补场效应晶体管），光刻机需要杀青 0.55 甚而 0.75 的数值孔径，晶圆厂的造价将飙升至 300 亿好意思元以上。这是一场唯有顶级玩家才能参与的豪赌。
01 1nm 量产音书收敛
在量产进程上，几家巨头的时刻表既相互追赶又各有保留。
算作大众晶圆代工的龙头，台积电拿下了大众晶圆代工市集近 70% 的份额，在先进制程范畴更是永远领跑行业。当今其 2nm N2 工艺于 2025 年年底杀青量产，本年迎来苹果、AMD 等头部客户的范围商用；后续的 A16 工艺将由 NVIDIA 费曼 GPU 首发，年底启动试产，2027 年理解量产。
在更前沿的 1nm 赛说念，台积电的布局早已落地。按照筹划，其首个埃米级工艺 A10（1nm）将于 2030 年理解面世，届时选拔台积电 3D 封装技巧的芯片，晶体管数目将冲突 1 万亿个，即即是传统封装芯片，晶体管范围也将逾越 2000 亿个。产能配套方面，总面积达 531 公顷的台南沙仑园区将于本年 4 月干涉二期环评，2027 年三季度完成最终环评。凭据台积电之前公布的筹划，园区筹划建筑 6 座晶圆厂，其中 P1-P3 工场主攻 1.4nm 工艺 A14，P4-P6 工场则专为 1nm 工艺 A10 布局，后期不摒除还有 0.7nm 工艺。此外，有音书称，台积电筹划的台南 Fab 25 晶圆厂可容纳 6 条产线，相似按照 P1-P3 产线适配 1.4nm、P4-P6 产线适配 1nm 的规格布局。在 A10 之前，台积电展望将于 2028 年推出 1.4nm 工艺 A14，升级第二代 GAA 晶体管结构与后头供电技巧。
三星电子的晶圆代工业务已定下 2030 年前完成 1nm 级先进制程工艺 SF1.0 开发并滚动至量产阶段的意见，意图与台积电争夺先进制程谈话权。
三星的激进背后，是窘态的现实窘境。尽管在 2nm 工艺上率先发布 Exynos 2600 芯片，但其试产良率仅为 30%，本年年头其 2nm GAA 制程 ( SF2 ) 的良率才普及至 50%。而竞争敌手台积电的 2nm 工艺良率初期便达到 60%。更严峻的是，高通、AMD 等中枢客户捏续将订单转向台积电，就连三星自家的 Galaxy S25 系列也弃用 Exynos 芯片，转投高通骁龙怀抱。
英特尔在 2024 年的 Foundry Direct Connect 行动上更新了道路图：14A（1.4nm）节点将于 2026 年运行坐褥，而 10A（1nm）节点将于 2027 年底干涉开发 / 坐褥阶段。
日本 Rapidus也在积极布局。Rapidus 是由包含索尼（Sony）与丰田（Toyota）在内的八家日本大型企业共同缔盟树立，贪心是将与台积电之间的技巧差距大幅镌汰至六个月之内。当今正在积极开发 1.4nm 技巧，2029 年运行坐褥。然而，部分市集分析师预测，Rapidus 可能会尝试提前在 2028 年底就启动营运。这家日本晶圆代工场在业务鼓吹上展现了苍劲的动能，但它仍濒临严峻的结构性挑战，即日本枯竭能够消化 1nm 宏大需求的大型 Fabless 市集。
02 1nm 技巧实力分析
1nm 制程的技巧挑战远超以往，中枢在于晶体管架构的代际跃迁。
从 GAA 到 CFET 的进化
现时 2nm 节点多量选拔 GAA（Gate-All-Around，环绕栅极）纳米片晶体管，但 1nm 节点需要更激进的架构。IMEC 的道路图露出，从 2nm 到 A7（0.7nm）节点将选拔 Forksheet（叉片）设想，随后在 A5 和 A2 节点引入 CFET（Complementary FET，互补场效应晶体管）。
三星已明确将在 1nm 节点选拔 Forksheet 结构——这是 GAA 纳米片的进化版，在程序 GAA 基础上新增介质壁，可进一步普及晶体管密度与性能。台积电在 1nm 制程中可能不会立即选拔 CFET，而是链接优化 GAA 架构。
CFET 的中枢冲突在于 3D 垂直堆叠：将 N 型与 P 型晶体管险阻堆叠，分享团结栅极，面积可缩减 50%，电流密度普及 2 倍 。这意味着在相似的芯单方面积上，晶体管密度将杀青质的飞跃。不外，CFET 架构对晶圆正面层叠工艺的精度条款达到了原子级，多层器件的对皆难度极高，产业化落大地临不小的挑战。
值得留心的是，按此前的技巧旅途，开云app官方在线CFET 本是下一代架构的公认标杆。但中国北京大学建议的 FlipFET 技巧，初次杀青了 8 层晶体管的三维垂直集成，单元面积逻辑密度较传统 FinFET 普及 3.2 倍，功耗责骂 58%。这一冲突性后果被业界视为不时摩尔定律的最具后劲决议之一。不同于 CFET 依赖复杂的晶圆正面层叠工艺，FFET 先在晶圆正面制造 n 型晶体管（如 FinFET NMOS），再通过键合另一晶圆并翻转减薄，在后头制造 p 型晶体管（如 FinFET PMOS）。这种结构无需垂直堆叠，而是通过物理翻转杀青 n/p 器件的空间分离，从根底上幸免了 CFET 的多层对皆辛苦。
光刻技巧的极限挑战
1nm 制程对光刻技巧建议了近乎尖酸的条款。ASML 的 High-NA EUV（0.55 NA）光刻机仍是委用，其永别率普及至 8nm 线宽，表面上在双重曝光下可救助 1nm 芯片坐褥。但每台征战成本逾越 3.5 亿欧元，重达 15 万公斤，需要 250 名工程师消耗 6 个月拼装。
更远处的是 ASML 正在研发的 Hyper-NA EUV（0.75 NA），展望 2030 年前后推出，对应居品定名为 HXE 系列。ASML 展望，Hyper AN 光刻机大约能作念到 0.2nm 甚而更先进工艺的量产，但当今还不行十足驯顺。
后头供电与新材料
为缓解布线拥塞，1nm 节点将多量选拔后头供电集聚（BSPDN）技巧，将电源传输集聚移至晶体管后头，从而普及信号无缺性并责骂功耗。此外，二维材料如二硫化钼（MoS ₂）算作晶体管沟说念材料的议论也在加快，其在 1nm 圭臬下仍能保捏开关特质，电子移动率比硅高 10 倍。
03 1nm 市集后劲
台积电预测，到 2030 年，选拔 3D 封装技巧的芯片晶体管数目将逾越 1 万亿个，而选拔传统封装技巧的芯片晶体管数目将逾越 2000 亿个。比拟之下，现时英伟达 GH100 唯有 800 亿个晶体管。
这意味着什么？AI 教训芯片的算力将迎来新一轮爆发。台积电指出，从 5nm 到 A14 的每一代工艺，都将杀青约 30% 的功耗服从普及、15% 的性能增益和 20% 的晶体管密度普及。
三星则将 1nm 的赌注押在 AI 芯片上。据韩媒报说念，特斯拉的 AI6 芯片将选拔三星的 SF2T 工艺于 2027 年量产，而三星的 1nm 工艺将对准下一代 AI 加快器。
更值得关怀的是，1nm 芯片的制形成本将达到天文数字。从 3nm 到 2nm，晶圆成本已从约 1.8 万好意思元涨至 3 万好意思元。若不时这一趋势，1nm 晶圆成本可能达到 4.5 万好意思元以上（约合 32 万东说念主民币），甚而更高。这不仅考验着芯片设想公司的财力，更可能重塑统共半导体产业的生意样式。
04 背后的赢家
在这场 1nm 制程的大众角逐中，除了晶圆代工巨头的正面交锋，产业链上游的中枢玩家，早已成为决定战局的关键力量，甚而是这场竞赛的隐形赢家。
首当其冲的是光刻机巨头 ASML。ASML 控制先进光刻机市集，占据 90% 份额，其 EUV 和高数值孔径 EUV 光刻机是 3nm 及以下制程芯片的中枢征战。在 1nm 的角逐中，ASML 依旧是无可替代的关键变装。
近日，imec 秘书 ASML EXE:5200 高数值孔径 EUV 光刻系统理解上市，这是当今开首进的光刻器具。imec 展望 EXE:5200 高数值孔径 EUV 光刻系统将于 2026 年第四季度完周至面认证。与此同期，位于费尔德霍芬的 ASML-imec 连结高数值孔径 EUV 光刻实验室将链接运营，确保 imec 极度生态系统妥洽伙伴的高数值孔径 EUV 研刊行动的邻接性。ASML 的 EXE:5200（High-NA EUV）将成为 1nm 工艺的入场券。
此外，刻蚀、薄膜千里积等其他工艺征战亦然重中之重。本年三月，IBM 秘书与半导体征战制造商泛林 ( Lam Research ) 就亚 1nm 顶端逻辑制程的开发达成妥洽，两边为期 5 年的新左券将重心聚焦新材料、先进蚀刻 / 千里积工艺、High NA EUV 光刻的连结开发。两家企业将衔尾 IBM 奥尔巴尼园区的先进议论技艺和泛林的端到端工艺器具和改革技巧，团队将构建并考证纳米片和纳米堆叠器件以及后头供电的无缺工艺进程。这些技艺旨在将 High NA EUV 图案可靠地滚动到实践器件层中，杀青高良率，并救助捏续的微缩化、性能普及以及过去逻辑器件的可行量产旅途。
而把持材料也在近日秘书推出两款适用于埃级工艺（1 埃米 = 0.1 纳米）的千里积征战，这两款征战已导入当先逻辑芯片制造商的 2nm 及以下顶端工艺中。把持材料示意，GAA 全环绕栅极结构正成为顶端工艺的势必之选，可带来权臣的能效普及。不外 GAA 的结构相较 FinFET 也更为复杂，需要逾越 500 说念工序方能制造，而这其中不少都要用到全新的材料千里积模范。
总的来看，1nm 制程的竞赛实践上是一场 " 技巧、本钱和耐烦 " 的立体干戈。台积电依旧四平八稳，依靠客户粘性和技巧蓄积保捏当先；三星试图通过激进的道路图和架构改革（Forksheet）杀青弯说念超车；英特尔则但愿借助好意思国芯片法案的救助，在 2027 年重返第一梯队；而 Rapidus 算作新玩家，正试图用 " 快鱼吃慢鱼 " 的策略在瑕玷中寻找契机。而在这背后，还需要半导体征战商的救助。
1nm 是否会成为摩尔定律的至极？大约在 2030 年，当第一派 A10 晶圆下线时开云app官方在线入口，咱们才能找到谜底。但不错细则的是，这场 " 角逐 1nm" 的交游，仍是悄然打响。
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